À propos de Najeh
Un consultant sénior en systèmes embarqués avec plus de 6 ans d'expérience dans des différents domaines comme le robotique, l'Iot, le transport et le ferroviaire. Ma dernière mission avec Faiveley transport m'a permit de monter en compétences et évoluer d'un milieu avec des fortes contraintes.
J'aime bien être entourer par différents types de personnes afin de pouvoir apprendre et partager mon savoir faire avec les autres.
Je suis quelqu'un qui aime le sport. J'aime jouer au Ping-Pong et je cherche toujours quelqu'un pour le défier.
Arabe
Bilingue ou natif
Anglais
Capacité professionnelle complète
Français
Bilingue ou natif
Accepte de travailler sur site
Tours (jusqu’à 50 km), Paris (jusqu’à 100 km)
Expériences
- VeoneerArchitect logiciel embarquéAUTOMOBILEnovembre 2022 - Aujourd'hui (3 ans et 7 mois)Cergy, France
- Faiveley Transport (groupe Wabtec)Ingénieur systèmes embarquésTRANSPORTSfévrier 2020 - octobre 2022 (2 ans et 9 mois)Tours, FranceProjet 1 : Soft Bootloaders + Applicatifs Produit ATESS4G TGV M (A partir de scratch)▪ Définir les exigences logicielles en se basant sur les specs systèmes.▪ Définir l’architecture logicielles et rédiger les documents de traçabilités des exigences.▪ Développement des différents composants logiciels en langage C du bootloader à exécuter sur le MCUSTM32H753, ARM M7, pour 4 cartes et le STM32G473, ARM M4, pour 2 cartes de l'ATESS4G.▪ Développer en respectant les exigences logicielles pour les différents périphériques (FDCAN, USB, FLASH,RAM, DMA, SHA256, CRC16, RCC, NVIC, TIM, GPIO).▪ Développer les composants logiciels qui vérifies l’intégrité du binaire applicatif avant chaque démarrage.▪ Développer les composants logiciels qui gères la mise à jour des fichiers binaires à travers le bus CAN et l’USB.▪ Développement des composants applicatifs SIL2 pour les mesures tensions sur l’ADC, transmissions desdonnées sur l’I2C/SPI, mesures vitesses, gestion des votes, gestions des défauts, gestions des infos systèmesen FALSH/RAM, Protections et sécurité de la mémoire, gestion des IWDG, gestion des entrées/sorties etgestions des contraintes temporelles dans la tache cyclique et la tache de fond.▪ Projet 2 : Journal des défauts SIL2 (A partir de scratch)- Enregistrement des événements et défauts avec leurs contextes dans la mémoire RAM en tache cyclique.- Ecriture en mémoire FLASH à chaque apparition d’un défaut en respectant les contraintes temporelles del’applicatif. Lecture, vidage et effacement du journal des défauts avec des trames CAN et USB.- Assurer le respect de la norme de codage MISRA C 2012 et les règles de codage internes Faiveley.▪ Assurer les tests fonctionnels des composants développés sur les cartes et les bancs des tests.▪ Utilisation de l'outil Polyspace BugFinder pour analyser chaque composant logiciel et rapporter les résultats.▪ Assurer le CI/CD de chaque composant logiciel développé à l'aide des outils SVN, ClearVersion, Docker et Jenkins.▪ Faire les revues de codes et documents des autres membres de l’équipe.
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- Diplôme d'ingénieur en génie système électronique et communication,ENET'COM.2016Diplôme d'ingénieur en génie système électronique et communication,
- Diplôme d'études préparatoires d'entrer aux écoles d'ingénieurs,IPEIM2013Diplôme d'études préparatoires d'entrer aux écoles d'ingénieurs,